DRAM Layout Engineer: Design & Verification Expert (Ciudad de México)

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08 oct
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Micron
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Ciudad de México

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Micron

Ciudad de México

Micron Technology is seeking a DRAM Layout Engineer to translate schematics into physical IP layouts for DRAM chips. You will verify layouts, optimize area and routing, and ensure timely delivery across integral teams.The role requires 3+ years of CMOS layout experience, strong problem-solving, and proficiency with Cadence Virtuoso, Calibre, and Mentor tools. You will collaborate with design groups worldwide to meet project milestones.

#J-18808-Ljbffr

📌 DRAM Layout Engineer: Design & Verification Expert (Ciudad de México)
🏢 Micron
📍 Ciudad de México

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