DRAM Design Layout Engineer (IP & Verification) (San Pedro Tlaquepaque)

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11 sep
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Micron Technology
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San Pedro Tlaquepaque

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Micron Technology

San Pedro Tlaquepaque

Micron Technology, Inc. is seeking a DRAM Design Technology Layout Engineer to translate schematics into IP layouts for DRAM chips. You will ensure on-time delivery with quality and collaborate with integral teams on layout and verification.

In this role you will apply multiple layout techniques, perform LVS/DRC/EM checks, and support area/time estimations, while guiding peers and contributing to project schedules within a fast-paced semiconductor environment.

#J-18808-Ljbffr

📌 DRAM Design Layout Engineer (IP & Verification) (San Pedro Tlaquepaque)
🏢 Micron Technology
📍 San Pedro Tlaquepaque

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